Variantes de Sistema de Almacenamiento para un Detector de Radar en el Espacio de los Momentos

Autores/as

  • Camilo Guillén Soriano Universidad Tecnológica de La Habana "José Antonio Echeverría", CUJAE
  • Carlos Luis Marcos Rojas Universidad Tecnológica de La Habana "José Antonio Echeverría", CUJAE
  • Nelson Chávez Ferry Universidad Tecnológica de La Habana "José Antonio Echeverría", CUJAE

Palabras clave:

FPGA, memorias RAM, método DRACEC

Resumen

Los detectores de radar con toma de la decisión en el espacio de los momentos (método DRACEC), requieren muestrear los parámetros de las señales provenientes de la región explorada y almacenar estas muestras teniendo en cuenta la célula resolutiva que les dio origen. El presente artículo propone la implementación en FPGA de dos variantes de sistema de almacenamiento, cada una de la cuales garantiza la identificación precisa de la célula que corresponde a un determinado conjunto de muestras. La primera variante está basada en sistemas digitales secuenciales que controlan una memoria RAM estática, mientras que la segunda utiliza un microprocesador en conjunto con memorias RAM internas al FPGA. Los sistemas desarrollados permiten el almacenamiento ordenado de las muestras como se requiere para las etapas posteriores de los detectores de radar que empleen el método DRACEC

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Publicado

2019-02-15

Número

Sección

Artículos