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Estudio comparativo de los divisores en tecnologías CMOS nanométricas


 
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1. Título Título del documento Estudio comparativo de los divisores en tecnologías CMOS nanométricas
 
2. Creador/a Nombre de autor/a, institución, país Gashaw Sassaw; España
 
2. Creador/a Nombre de autor/a, institución, país Carlos J. Jiménez; España
 
2. Creador/a Nombre de autor/a, institución, país José M. Mora; España
 
2. Creador/a Nombre de autor/a, institución, país Manuel Valencia; España
 
3. Materia Disciplina(s)
 
3. Materia Palabra/s clave
 
4. Descripción Resumen

Son varios los algoritmos de divisores propuestos para su realización en hardware, sin que haya un ‘mejor divisor’. La búsqueda de un diseño óptimo para cada aplicación específica hace que sea indispensable la investigación de los algoritmos existentes a medida que se produce el avance de la tecnología.

En este trabajo se presentan los resultados de la caracterización en área, tiempo y consumo de potencia de varias implementaciones de divisores en tecnologías CMOS nanométricas de 90 y 65 nm. Para la implementación se ha utilizado un flujo de diseño ASIC semicustom con elección entre tres voltajes umbrales.
 
5. Editorial Institución organizadora, ubicación Universidad Tecnológica de La Habana José Antonio Echeverría
 
6. Colaborador/a Patrocinador(es)
 
7. Fecha (DD-MM-AAAA) 2010-11-05
 
8. Tipo Estado y género Artículo revisado por pares
 
8. Tipo Tipo
 
9. Formato Formato de archivo PDF
 
10. Identificador Identificador uniforme de recursos http://rielac.cujae.edu.cu/index.php/rieac/article/view/49
 
11. Fuente Título; vol., núm. (año) Revista Ingeniería Electrónica, Automática y Comunicaciones ISSN: 1815-5928; Vol. 30, Núm. 2 (2009)
 
12. Idioma Español=es es
 
13. Relación Archivos complementarios
 
14. Cobertura Localización geoespacial, periodo cronológico, muestra de investigación (sexo, edad, etc.)
 
15. Derechos Derechos de autor/a y permisos Copyright (c)